Quelltext der Seite Peripheral Component Interconnect

[[Datei:PCI-Bus.jpg|mini|hochkant=1.3|32 bit-PCI-[[Steckplatz]]]]
[[Datei:NIC-FA312.jpg|mini|hochkant=1.3|32 bit-PCI-[[Netzwerkkarte]]: links das genormte Blech mit der Anschlussbuchse, unten die Kontakte für den Erweiterungsslot direkt auf der Leiterplatte]]
[[Datei:Intelpromtserverpcixadapter1000mta342.jpg|hochkant=1.3|mini|Ethernetkarte (NIC) für den PCI-X-Slot.]]
[[Datei:PCI-X Riser.jpg|mini|hochkant=1.3|PCI-X-[[Riser-Karte]]]]
[[Datei:PCI-E & PCI slots on DFI LanParty nF4 SLI-DR 20050531.jpg|mini|hochkant=1.3|PCI-Express- und PCI-Steckplätze auf einer PC-[[Hauptplatine]]: von oben nach unten: PCI-Express x4, x16, x1, x16 und konventionelles PCI]]
'''Peripheral Component Interconnect''', meist '''PCI''' abgekürzt, ist ein [[Bus (Datenverarbeitung)|Bus]]-Standard zur Verbindung von [[Peripheriegerät]]en mit dem [[Chipsatz]] eines [[Prozessor]]s.

Es gibt zahlreiche Varianten und Einsatzgebiete des Standards ([[Personal Computer|PC]], [[Industrie]], [[Telekommunikation]]). Die bekannteste Variante kommt hauptsächlich im PC-Umfeld zum Einsatz und heißt offiziell ''PCI Conventional''. Praktisch jeder seit etwa 1994 gebaute [[IBM-PC-kompatibler Computer|IBM-PC-kompatible Computer]] ist mit meist zwei bis sieben Steckplätzen für PCI-Karten ausgerüstet (ausgenommen Miniatur- und mobile Versionen). Auch neuere Computer von [[Apple]] (von 1995 bis 2005, später dann [[PCI Express]]) und Workstations von [[Sun Microsystems|Sun]] besitzen einen PCI-Bus. In die Steckplätze können allerlei Karten vieler Hersteller eingesetzt werden, darunter [[Netzwerkkarte]]n, [[Modem]]s, [[Small Computer System Interface|SCSI]]-Karten, [[Soundkarte]]n, (ältere oder Zweit-)[[Grafikkarte]]n, Karten mit einem [[IEEE 1284|Parallel-Druckeranschluss]] oder mit zusätzlichen [[Universal Serial Bus|USB]]-Steckplätzen. Damit kann ein PC leicht an spezielle Bedürfnisse angepasst werden.

== Versionen und Geschichte ==
Version 1.0 des Standards wurde von [[Intel]] im Jahre 1991 definiert. Intel unterstützte den [[VESA Local Bus|'''V'''ESA '''L'''ocal '''B'''us]] (VLB) nicht, da dieser speziell auf die [[Intel 80486|486]]-Architektur zugeschnitten war und weniger Durchsatz bot. Im Gegensatz dazu kann der PCI-Bus in jeder Architektur eingesetzt werden.

Mittlerweile existieren drei verschiedene Standards:
; Konventioneller PCI:
* PCI 1.0, vorgeschlagen von Intel 1991
* PCI 2.0, eingeführt von [[#Special Interest Group|PCI-SIG]] 1993
* PCI 2.1, beschlossen im Juni 1995
* PCI 2.2, beschlossen im Januar 1999
* PCI 2.3, beschlossen im März 2002
* PCI 3.0, beschlossen im April 2004
; PCI-Extended (PCI-X):
* PCI-X 1.0, beschlossen im September 1999
* PCI-X 2.0, beschlossen im Juli 2002
; [[PCI Express]] (PCIe oder PCI-E):
* ursprünglich bekannt als 3GIO
* PCI Express 1.0, beschlossen Juli 2002
* PCI Express 1.1
* PCI Express 2.0, beschlossen 2007
* PCI Express 2.1
* PCI Express 3.0, beschlossen 2010
* PCI Express 4.0, beschlossen 2017
* PCI Express 5.0, beschlossen 2019
* PCI Express 6.0, beschlossen 2022
* PCI Express 7.0, geplant für 2025

Der PCI-Bus hat den [[Industry Standard Architecture|ISA]]-Bus und den kurzlebigen [[VESA Local Bus|VL-Bus]], wie man sie in älteren PCs findet, ersetzt. Eine PCI-ISA-Bridge erlaubt jedoch die Anbindung des ISA-Busses an den PCI-Bus. Auf Systemen der [[Intel Pentium|Pentium]]-Generation und neuer ist das die einzige Möglichkeit, ISA-Karten anzubinden, da es sich beim ISA-Bus um den nach außen gelegten Systembus des Ur-PCs handelt. Der PCI-Bus erfüllte die Anforderungen für Grafik-, Netzwerk- und andere Schnittstellenkarten über längere Zeit.

Allerdings war er nach einiger Zeit nicht mehr schnell genug für die damals aufkommenden Grafikkarten mit 3D-Beschleunigung. 1997 etablierte man daher zusätzlich den [[Accelerated Graphics Port]] (AGP). Dieser baut auf dem PCI-Bus auf, ist jedoch als Punkt-zu-Punkt-Verbindung mit ergänzenden Seitenkanälen ausgeführt und wurde mittlerweile bis zum 8-fachen seiner ursprünglichen Übertragungsrate weiter entwickelt. Für so gut wie alle anderen [[Steckkarte]]ntypen blieb PCI dagegen bis heute Standard, wurde seit 2005 durch [[PCI Express]] ersetzt (siehe unten).

Anders als der ISA-Bus ermöglicht PCI die dynamische Konfiguration eines Gerätes ohne Eingriff des Benutzers. Während des Bootvorgangs analysiert das System-[[BIOS]] die vorhandenen PCI-Geräte und weist die benötigten Ressourcen zu. Das erlaubt die Zuweisung von [[Interrupt|IRQs]], Portadressen und Speicherbereichen entsprechend den lokalen Gegebenheiten. Bei ISA-Karten musste man häufig den zu verwendenden IRQ etc. per [[Jumper (Elektrotechnik)|Steckbrücke]] manuell einstellen. Zusätzlich stellt der PCI-Bus dem Betriebssystem und anderen Programmen eine detaillierte Beschreibung aller verbundenen PCI-Geräte durch den PCI Configuration Space zur Verfügung.

Die PCI-Spezifikation regelt auch die physische Auslegung des Busses (unter anderem den Abstand der Leiterbahnen zueinander), elektrische Eigenschaften, Timing und Protokolle. Die Geräte oder [[Schnittstelle]]n müssen nicht unbedingt auf [[Steckkarte]]n untergebracht werden, sondern können sich auch direkt auf der Hauptplatine des Computers befinden, die Spezifikation spricht hier von ''planar devices''.

== Allgemeine PCI-Bus-Spezifikationen ==
[[Datei:Prinzipielle Darstellung der PCI-Architektur.svg|581px|mini|Prinzipielle Darstellung der PCI-Architektur]]

{| class="wikitable floatright"
|+ Detektion und Konfiguration von PCI erfolgt über zwei IO-Register
|- class="hintergrundfarbe6"
! Bits
! Anz.<br />Bits
! Bereich
! Beschreibung
|-
| class="hintergrundfarbe5" colspan="4" | '''32 bit-Port: 0CF8h'''
|-
| {{0}}0…1
| {{0}}2
| {{0}}0…3
| Auswahl der Übertragung:<br /> 00 = Configuration PCI-Brücke<br /> 01 = Configuration PCI-Einheit
|-
| {{0}}2…7
| {{0}}5
| {{0}}0…31
| Auswahl der Registernummer
|-
| {{0}}8…10
| {{0}}3
| {{0}}0…7
| Auswahl der PCI Funktion (Registergruppe)
|-
| 11…15
| {{0}}5
| {{0}}0…31
| Adresse der PCI-Einheit, des PCI-Ports; <span class="hintergrundfarbe7">&nbsp; unbenutzt für Übertragung 00 &nbsp; </span>
|-
| 16…23
| {{0}}8
| {{0}}0…255
| Busnummer; <span class="hintergrundfarbe7">&nbsp; unbenutzt für Übertragung 00 &nbsp; </span>
|-
| 24…31
| {{0}}8
| {{0}}0…255
|
|-
| class="hintergrundfarbe5" colspan="4" | '''32 bit-Port: 0CFCh'''
|-
| {{0}}0…31
| 32
| {{0}}0…2<sup>32</sup>−1
| Lesen / Schreiben der Daten des ausgewählten Registers
|}

Der PCI-Bus ist ein synchroner Bus mit 33,33&nbsp;[[Hertz (Einheit)|MHz]] (=&nbsp;30&nbsp;ns pro Takt) oder nach der 2.1-Spezifikation 66,66&nbsp;MHz Taktrate, also 15&nbsp;[[Sekunde|ns]] pro Takt. Diese Werte sind Maximalwerte, nach der Spezifikation kann der Takt auch niedriger und zudem variabel sein, beispielsweise zum Stromsparen. Deshalb hat der Bus eine Taktleitung. Alle Signale werden nur bei steigender Taktflanke übertragen ([[Single Data Rate]]). Die Signale können über CMOS-Treiber angesteuert werden, daher ist der gesamte Stromverbrauch relativ gering. Der Bus kann mit bis zu 10 Geräten bestückt werden, wobei zwischen Master (Kontrolleur der Übertragung) und Slave (muss vielleicht auf Daten (oder Befehle) warten) unterschieden wird. Ein Master kann bei Bedarf selbst die Kontrolle über Abläufe auf dem Bus übernehmen, was vor allem für Karten mit hohem [[Eingabe und Ausgabe|IO]]-Aufkommen, wie etwa Netzwerkkarten oder Festplatten-Controller, vorteilhaft ist. Als Geräte zählen auch auf der Hauptplatine untergebrachte Geräte, die Verbindung zum [[Hostrechner|Host]] (PCI/Host-Schnittstelle) oder zu einem eventuell vorhandenen ISA-Bus (PCI/ISA-Schnittstelle) aufnehmen. Für mehr als 10 PCI-Geräte pro System können über PCI/PCI-Schnittstellen (PCI-PCI-Bridge) weitere PCI-Busse in das System eingebunden werden. Die Datenübertragung läuft parallel ab.

Auf dem PCI-Bus kommuniziert immer ein Master mit einem Slave. Die meisten PCI-Geräte können sowohl als Slave angesprochen werden als auch als Master Transaktionen starten. Über einen [[Arbiter]] wird ein Master ausgewählt, der dann die Kontrolle über den Bus hat. Er beginnt einen Transfer, indem er eine Adresse an die 32 Daten/Adressleitungen und ein Kommando an 4 Kommando/Byte-Leitungen anlegt. Die Daten und Adressen werden über dieselben Leitungen übertragen und per [[Multiplexverfahren#Zeitmultiplexverfahren (TDMA)|Zeitmultiplexverfahren]] voneinander getrennt. Eine zusätzliche [[Paritätsbit|Paritätsleitung]] erlaubt das Erkennen von Fehlern.

[[Prozessor|CPU]] und [[Arbeitsspeicher]] sind über eine sogenannte Host-Bridge mit dem Bus verbunden. Die meisten Transaktionen auf dem Bus finden zwischen dieser Bridge und den restlichen Peripheriegeräten statt. Theoretisch können Peripheriegeräte auch untereinander kommunizieren, diese Möglichkeit wird jedoch nur sehr selten genutzt und von den meisten Bridges nur optional unterstützt. Da masterfähige Peripheriegeräte die Hostbridge als Slave ansprechen können, sind sie in der Lage, direkt in den Arbeitsspeicher zu schreiben und aus ihm zu lesen – das entspricht [[Direct Memory Access]] (DMA).

Jedem Slave werden beim Systemstart vom BIOS Adressbereiche zugeteilt. Über Herstellercodes können Karten nach dem Hochfahren eindeutig identifiziert werden. Über die Datenleitungen werden dann Daten übertragen, wobei die Kommando/Byte-Leitungen zur Auswahl der Bytes im 32-Bit-Wort dienen können. Dadurch sind neben 32-Bit- auch 16- und 8-Bit-Transfers möglich.

In der am weitesten verbreiteten PCI-Variante mit 32&nbsp;bit/33&nbsp;MHz können in jedem Takt maximal 32&nbsp;Bit, also 4&nbsp;Bytes übertragen werden, so dass die Transferrate maximal 133&nbsp;MByte/s beträgt (4&nbsp;Bytes in 30&nbsp;ns). Über Ready-Leitungen kann sowohl der Master als auch der Slave signalisieren, dass sie zur Aufnahme von Daten bereit sind. Falls Master oder Slave nicht bereit sind, werden keine Daten übertragen, die Übertragung wird angehalten oder gebremst.

Normalerweise beendet der Master den Datentransfer. Über ein STOP-Signal kann der Slave ein Übertragungsende erzwingen. Ein anderer Master kann den Bus über REQ anfordern, wobei die derzeitige Übertragung nach einer vorgegebenen [[Latenzzeit (Technik)|Latenzzeit]] beendet werden muss und der neue Master den Bus übernehmen kann.

Der PCI-Bus benötigt minimal 47 (Slave) bzw. 49 (Master) Signale auf dem Bus. Ab der Version 2.1 der Spezifikation ist eine 64-Bit-Erweiterung definiert, die den Datenbus auf 64 Bit verbreitert. In einem System können 32-Bit- und 64-Bit-Geräte koexistieren und miteinander kommunizieren.

Auf dem Bus liegen vier [[Interrupt]]leitungen, so dass jedes Gerät bis zu vier verschiedene Interrupts (INTA bis INTD) erzeugen kann. Die Interruptleitungen sind auf dem Bus aber nicht verbunden, sondern können einzeln [[Routing|geroutet]] und zugeordnet werden. Normalerweise wird nur INTA verwendet. Dieser kann jedoch je nach Steckplatz einem eigenen Interrupt zugeordnet werden oder, falls nicht genügend Interrupts vorhanden sind, zwischen verschiedenen Karten geteilt werden. Die Probleme des ISA-Busses, der oft zu wenig Interrupts zuordnen konnte, sind damit weitgehend Vergangenheit.

Der PCI-Bus versorgt die angeschlossenen Geräte mit Spannung. Für jede Versorgungsspannung ist die maximal zulässige [[Elektrische Stromstärke|Stromstärke]] festgelegt.<ref name="Hardware and PCI Overview FAQs">[http://developers.sun.com/solaris/developer/support/driver/hardware-pci-faqs.html ''Hardware and PCI Overview FAQs''.] sun.com, 4. Dezember 2008.</ref> Weiterhin ist die Gesamtleistung pro Steckplatz auf 25 Watt begrenzt.

{| class="wikitable float-right" style="text-align:center"
|-
! Spannung !! Strom<br />(max) !! Leistung<br />(max)
|-
| {{0}}+3,3&nbsp;V ± 0,3&nbsp;V || 6&nbsp;A || 20&nbsp;W
|-
| {{0}}+5&nbsp;V ± {{0}}5 % || 5&nbsp;A || 25&nbsp;W
|-
| +12&nbsp;V ± {{0}}5 % || 0,5&nbsp;A || 6&nbsp;W
|-
| −12&nbsp;V ± 10 % || 0,1&nbsp;A || 1,2&nbsp;W
|-
! colspan="2"| Summe der Gesamtleistung || 25&nbsp;W
|}
{| class="wikitable" style="text-align:center; border-width:0;"
! rowspan="2"| Parameter
! rowspan="8" style="background:#FFFFFF; border-width:0;"|
! rowspan="2"| PCI<br />2.0
! colspan="2"| PCI 2.1
! rowspan="2"| PCI<br />2.2
! rowspan="2"| PCI<br />2.3
! rowspan="2"| PCI<br />3.0
! rowspan="8" style="background:#FFFFFF; border-width:0;"|
! colspan="4"| PCI-X
! rowspan="8" style="background:#FFFFFF; border-width:0;"|
! colspan="4"| Zum Vergleich: AGP
|-
! 32&nbsp;bit
! 64&nbsp;bit
! colspan="2"| 1.0
! colspan="2"| 2.0
! 1x
! 2x
! 4x
! 8x
|-
|style="text-align:left;"| Max. Busbreite
|colspan="2" | 32 bit
|colspan="4" | 64 bit
|colspan="4" | 64 bit
|colspan="4" | 32 bit
|-
|style="text-align:left;"| Max. Takt (MHz)
| {{0}}33
|colspan="5" | {{0}}66
| 100
| 133
| 266
| 533
| {{0}}66
| 133
| 266
| 533
|-
|style="text-align:left;"| max. Datenrate (MB/s)
| 133
| 266
|colspan="4" | 533
| 800
| 1066
| 2133
| 4266
| 266
| 533
| 1066
| 2133
|-
|style="text-align:left;"| Slots pro Bridge
|colspan="2" | 4
|colspan="4" | 2
| 2
| colspan="3" | 1
| colspan="4" | 1
|-
|style="text-align:left;"| Spannung
|               5 V
| colspan="2" | 5/3,3 V
| colspan="3" | 3,3 V
| colspan="4" | 3,3 V
| colspan="2" | 3,3 V
| 1,5 V
| 0,8 V
|-
|style="text-align:left;"| Einführungsjahr
| 1993
| colspan="2" | 1994
| 1999
| 2002
| 2004
| colspan="2" | 1999
| colspan="2" | 2003
| colspan="2" | 1997
| 1999
| 2002
|-
|}

== PCI-Bus-Signale ==
Die Art der Ein- und Ausgänge lassen sich wie folgt einteilen:

{| class="wikitable"
|-
| Input || '''in''' || Normaler Eingang
|-
| Output || '''out''' || Normaler Ausgang
|-
| [[Tri-State]] || '''t/s''' || bidirektionaler Tri-State Ausgang
|-
| Sustained<br />Tri-State || '''s/t/s''' || [[Logikpegel|Low-aktiver]] Ausgang, der nur von einem Gerät getrieben werden darf. Setzt ein Gerät die Leitung auf ''low'', so muss es, um die Leitung wieder freizugeben, die Leitung für mindestens einen Takt auf ''high'' setzen. Frühestens nach einem Takt, nachdem die Leitung freigegeben wurde, darf ein anderes Gerät die Leitung nutzen. Ein zentraler [[Open circuit#Beschaltung der Signalleitungen|Pullup-Widerstand]] ist notwendig.
|-
| Open-Drain || '''o/d''' || Low-aktiver Ausgang, fungiert als [[Disjunktion|ODER]]-Verknüpfung mit anderen Geräten. Ein zentraler Pullup ist notwendig.
|}

{| class="wikitable"
|- style="background:#63B8FF"
| '''Signal''' || '''Art''' || '''Beschreibung'''
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Systemsignale:'''
|-
| '''CLK''' || in || Dient zur Synchronisation aller Komponenten. Die Taktfrequenz beträgt 33&nbsp;MHz oder 66&nbsp;MHz. Die Minimalfrequenz ist 0&nbsp;MHz.
|-
| '''RST#''' || in || Rücksetzen aller Systemkomponenten.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Adress- und Datensignale:'''
|-
| '''AD[31..0]''' || t/s || [[Multiplexer|gemultiplexte]] Adress- und Datensignale
|-
| '''C/BE[3..0]#''' || t/s || gemultiplexte Befehl- und Byte-Enable-Signale
|-
| '''PAR''' || t/s || Gerade [[Paritätsbit|Parität]] für die Daten- und Adresssignale (AD[31..0] und C/BE[3..0]), welche um einen Takt verzögert übertragen wird.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Kontrollsignale:'''
|-
| '''FRAME#''' || s/t/s || Dass eine Übertragung läuft, zeigt der Master mit FRAME# an. Wird die Übertragung der Daten beendet, nimmt der Master die Leitung zurück. Eine deaktivierte Leitung bedeutet, dass die Übertragung beendet wird oder beendet ist.
|-
| '''IRDY#''' || s/t/s || Der Master zeigt mit ''Initiator Ready'' an, dass ein Wort übergeben oder übernommen werden kann.
|-
| '''TRDY#''' || s/t/s || Der Target zeigt mit ''Target Ready'' an, dass ein Wort übergeben oder übernommen werden kann.
|-
| '''STOP#''' || s/t/s || Der Target zeigt dem Master an, dass die Übertragung beendet werden soll.
|-
| '''LOCK#''' || s/t/s || ''LOCK'' schützt einen Zugriff auf einen oder mehrere Target während der Übertragung vor der Benutzung anderer Master.
|-
| '''IDSEL''' || in || Auswahl während der Konfigurationsphase
|-
| '''DEVSEL#''' || s/t/s || Target hat Adresse erkannt
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''[[Arbiter|Arbitrierung]] (nur Master):'''
|-
| '''REQ#''' || s/t/s || Die Absicht eines Masters auf den Bus wird hiermit angezeigt. Dieses Signal ist eine Punkt-zu-Punkt-Verbindung von jedem Master zu einem zentralen Arbiter.
|-
| '''GNT#''' || in || Erlaubt den Zugriff auf den Bus. Dieses Signal ist eine Punkt-zu-Punkt-Verbindung von einem zentralen Arbiter zu jedem Master.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Fehlersignalisierung:'''
|-
| '''PERR#''' || s/t/s || Einen Takt nach ''PAR'' zeigt dieses Signal einen Daten-Parity-Fehler (nicht bei einem Special-Cycle-Befehl) an.
|-
| '''SERR#''' || o/d || ''System Error'' zeigt bei einem Special-Cycle-Befehl einen Daten- oder sonstigen Systemfehler an.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Interrupt-Signale:'''
|-
| '''INTA#''' || o/d || Ein Gerät mit einer Funktion zeigt einen Interrupt an. Ein Gerät mit mehr Funktionen zeigt einen Interrupt A an.
|-
| '''INTB#''' || o/d || Ein Gerät mit mehr als einer Funktion zeigt einen Interrupt B an.
|-
| '''INTC#''' || o/d || Ein Gerät mit mehr als einer Funktion zeigt einen Interrupt C an.
|-
| '''INTD#''' || o/d || Ein Gerät mit mehr als einer Funktion zeigt einen Interrupt D an.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''Cache Signale (optional, in PCI 2.x als veraltet deklariert):'''
|-
| '''SBO#''' || inout || ''Snoop Backoff'' zeigt einen „cache hit“ für eine modifizierte Cachezeile an.
|-
| '''SDONE''' || inout || ''Snoop Done'' zeigt das Ende eines Snoops des aktuellen Zugriffs an.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''zusätzliche Signale:'''
|-
| '''PRSNT1#'''<br />'''PRSNT2#''' || out || Zeigt das Vorhandensein einer Einsteckkarte und deren Energieverbrauch an. Mindestens eines der beiden Signale (3 verschiedene Kombinationen für 3 verschiedene Verbrauchsklassen) wird auf der Karte mit Masse verbunden und das eventuell andere bleibt offen. Diese Signale sind für jeden Slot individuell mit einem System-Chip verbunden und haben alle einen Pullup. Diese Signale sind nur bei Einsteckkarten vorhanden, bei On-Board-Peripherie gibt es diese nicht, da On-Board-Komponenten nicht austauschbar sind und der Stromverbrauch im Vorhinein bekannt ist.
|-
| '''CLKRUN#''' || o/d || Kontrolliert die Abschaltung des CLK-Signals zu Stromsparzwecken.
|-
| '''M66EN''' || o/d || Dieses Signal, das ursprünglich ein Massepin war, signalisiert die 66-MHz-Fähigkeit eines Geräts, indem es unverbunden bleibt oder als Eingang beschaltet wird. Ältere oder langsame Geräte verlangsamen den gesamten Bus auf 33&nbsp;MHz, indem sie das Signal mit Masse verbinden.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''64-Bit Erweiterungssignale:'''
|-
| '''D[63..32]''' || t/s || Die oberen 32 Bit der Datensignale.
|-
| '''C/BE[7..4]#''' || t/s || Die oberen 4 Bit der Befehls- und Byte-Enable-Signale.
|-
| '''REQ64#''' || s/t/s || ''Request64'' zeigt die Absicht eines Masters für eine 64-Bit-Übertragung an. Dieses Signal ist eine Punkt-zu-Punkt-Verbindung von einem zentralen Arbiter zu jedem Master.
|-
| '''GNT64#''' || in || ''Grant64'' erlaubt den Zugriff für eine 64-Bit-Übertragung. Dieses Signal ist eine Punkt-zu-Punkt-Verbindung von einem zentralen Arbiter zu jedem Master.
|-
| '''PAR64''' || t/s || ''Parity64'' über AD[63..32] und C/BE[7..4]# um einen Takt versetzt.
|-
|colspan="3" style="background:#CFCFCF; text-align:left"| '''[[Joint Test Action Group|JTAG]]-Signale:'''
|-
| '''TCK''' || in || ''Test Clock''
|-
| '''TDI''' || in || ''Test Data In''
|-
| '''TDO''' || out || ''Test Data Out''
|-
| '''TMS''' || in || ''Test Mode Select''
|-
| '''TRST#''' || in || ''Test Reset''
|}

'''Signale auf dem PCI-Bus''' – das '''#'''-Zeichen deutet an, dass die Signale ''Low Active'' sind.

== PCI-ID ==
Jedes Gerät bzw. Steckkarte an einem PCI-Bus besitzt eine eindeutige Hardware-Kennung (ID). Diese setzt sich aus drei Teilen zusammen, die zur Identifikation von Funktion (Class-ID), Hersteller und Modell (Geräte-ID) dienen.

&nbsp; &nbsp; &nbsp;'''<code>Class-ID : Hersteller-ID : Geräte-ID</code>'''

Beispiel:

&nbsp; &nbsp; &nbsp;'''<code>0200:8086:10B5</code>'''

Hierbei steht:
* '''0200''' für einen '''Ethernet Network Controller'''
* '''8086''' für die '''Intel Corporation''' (die Zahl ist zwar hexadezimal, aber die Ziffern würden bei Dezimalschreibweise für Intels Urvater der x86-Architektur stehen)
* '''10B5''' für das Gerät '''82546&nbsp;GB Gigabit Ethernet Controller (Copper)'''

Über die Class-ID wird das Gerät einer bestimmten Gruppe zugeordnet. Das erleichtert die Ermittlung unbekannter Geräte.

== Operationen auf dem PCI-Bus ==
Nach der Konfiguration aller Geräte durch das [[BIOS]] können alle Geräte über ein Befehlsprotokoll angesprochen werden. Dieses setzt sich aus dem Befehl, der Adresse und einer Folge von Daten zusammen.

{| class="wikitable"
|- style="background:#63B8FF"
|colspan="4" style="text-align:center"| '''C/BE''' ||rowspan="2"| '''Beschreibung'''
|- style="background:#63B8FF"
| '''3#''' || '''2#''' || '''1#''' || '''0#'''
|-
| '''0''' || '''0''' || '''0''' || '''0''' || Der ''Interrupt Acknowledge'' Befehl ist ein implizierter Lesezugriff auf den System-[[Programmable Interrupt Controller|Interruptcontroller]]. Die „byte enable“-Bits geben dabei die Größe des [[Interruptvektor]]s an.
|-
| '''0''' || '''0''' || '''0''' || '''1''' || Der ''[[#Begriffe|Special Cycle]]'' Befehl ist für einfache [[Broadcast]]-Nachrichten (?)
|-
| '''0''' || '''0''' || '''1''' || '''0''' || Der ''I/O Read'' Befehl ist für das Lesen aus dem Speicher, der als I/O-[[#Begriffe|Adressraum]] (englisch „address space“) eingebunden ist.
|-
| '''0''' || '''0''' || '''1''' || '''1''' || Der ''I/O Write'' Befehl ist für das Schreiben in den Speicher, der als I/O [[#Begriffe|Adressraum]] (englisch „address space“) eingebunden ist.
|-
| '''0''' || '''1''' || '''0''' || '''0''' || <span style="color:#888888;"> ''reserviert'' </span>
|-
| '''0''' || '''1''' || '''0''' || '''1''' || <span style="color:#888888;"> ''reserviert'' </span>
|-
| '''0''' || '''1''' || '''1''' || '''0''' || Der ''Memory Read''-Befehl ist für das Lesen aus dem Speicher, der als „Memory Address Space“ eingebunden ist.
|-
| '''0''' || '''1''' || '''1''' || '''1''' || Der ''Memory Write''-Befehl ist für das Schreiben in den Speicher, der als „Memory Address Space“ eingebunden ist.
|-
| '''1''' || '''0''' || '''0''' || '''0''' || <span style="color:#888888;"> ''reserviert'' </span>
|-
| '''1''' || '''0''' || '''0''' || '''1''' || <span style="color:#888888;"> ''reserviert'' </span>
|-
| '''1''' || '''0''' || '''1''' || '''0''' || Der ''Configuration Read''-Befehl liest aus den internen Konfigurationsregistern (Configuration Space).
|-
| '''1''' || '''0''' || '''1''' || '''1''' || Der ''Configuration Write''-Befehl schreibt in die internen Konfigurationsregister (Configuration Space).
|-
| '''1''' || '''1''' || '''0''' || '''0''' || Der ''Memory Read Multiple''-Befehl liest mehr als eine Cachezeile aus dem Speicher.
|-
| '''1''' || '''1''' || '''0''' || '''1''' || Der ''Dual Address Cycle''-Befehl erlaubt das Hintereinander-Senden von zwei 32-Bit-Adresszeilen, um einen 64-Bit-Adressbereich in einer 32-Bit-PCI-Umgebung ansprechen zu können.
|-
| '''1''' || '''1''' || '''1''' || '''0''' || Der ''Memory Read Line''-Befehl liest eine Cachezeile aus dem Speicher.
|-
| |'''1''' || '''1''' || '''1''' || '''1''' || Der ''Memory Write and Invalidate''-Befehl schreibt mindestens eine ganze Cachezeile in den Speicher.
|}
Auf <span style="color:#888888;"> ''reserviert''</span>-Befehle dürfen PCI-Geräte nicht reagieren.

== Grundlegende PCI-Varianten ==
* PCI Conventional, erlaubt Busbreiten von entweder 32 oder 64&nbsp;Bit und Übertragungen mit 33 oder 66&nbsp;MHz Takt (133 bis 533&nbsp;MByte/s)
* PCI-X, 64-Bit-Version von PCI Conventional mit 66, 100 oder 133&nbsp;MHz Takt (533, 800 oder 1067&nbsp;MByte/s)
* PCI-X 266 (PCI-X DDR/QDR), PCI-X mit 266&nbsp;MHz Nominaltakt (2133 bis 4266&nbsp;MByte/s)
* [[Mini PCI]], kleinere Bauform, nur 32&nbsp;Bit, für Notebooks etc.
* [[Personal Computer Memory Card International Association|PC Card oder Cardbus]], externe Karten (Nachfolger von PCMCIA), kleinere Bauform, 32&nbsp;Bit, für Notebooks etc.
* [[CompactPCI]], elektrisch voll PCI-kompatibel, jedoch in Form von Einschüben mit 3 bzw. 6&nbsp;[[Höheneinheit|HE]]
* [[PCI eXtensions for Instrumentation|PXI]], für die Messtechnik optimierte Weiterentwicklung des CompactPCI
* PCI Low-Profile, halbe Bauhöhe, 32 oder 64&nbsp;Bit, siehe [[#Abmessungen der PCI-Varianten|Tabelle]]
* PC/104-Plus, PCI-104 und PCI/104-Express, voll PCI-kompatibel für Stapelcomputer, Nachfolger von [[PC/104]]
* [[ASUS Media Bus]], proprietäre Lösung für die Erweiterung des PCI-Steckplatzes um einen [[Industry Standard Architecture|ISA]]-Anschluss für kombinierte Grafik- und Soundkarten, bzw. kombinierte [[Small Computer System Interface|SCSI]]-Controller und Soundkarten
* [[PCI Express]] (PCIe), wird als Standardsockel für Grafik- und Zusatzkarten (wie zum Beispiel [[RAID]]-Controller) benutzt.
* [[ExpressCard]], externe Karten (Nachfolger der 32 Bit [[Personal Computer Memory Card International Association|PC Card]]), zu PCIe kompatibel, kleinere Bauform, PCI-Express-1x-Schnittstelle (1 Lane), für Notebooks etc.

== Abmessungen der PCI-Varianten ==
{| class="wikitable" style="border-width:0;"
|- class="hintergrundfarbe8"
| rowspan="2" style="background-color:#FFF; border-width:0;" |
| colspan="3" align="center"                                 |'''Standard'''
| rowspan="6" style="background-color:#FFF; border-width:0;" |
| colspan="3" align="center"                                 |'''Low Profile'''
|-
! Kartentyp   || Zoll      ||     mm || Kartentyp || Zoll   || mm
|-
|               Minimale Höhe  ||             ||           ||        ||           || 0,945″ || {{0}}24 mm
|-
|               Maximale Höhe  ||             || {{0}}4,2″ || 107&nbsp;mm ||           || 2,536″ || {{0}}64 mm
|-
| rowspan="2" | Maximale Länge || kurze Karte || {{0}}6,6″ || 168&nbsp;mm || MD1       || 4,721″ || 119,91 mm
|-
|                                 lange Karte || 12,283″   || 312&nbsp;mm || MD2       || 6,6″   || 167,64 mm
|-
|}

== Kodierung der Kontaktleiste ==
[[Datei:PCI Keying.svg|480px|mini|Kodierungen für verschiedene 32-bit- und 64-bit-PCI-Karten]]

* 3,3-V-kompatible Karten haben eine Kerbe links (Richtung Slotblech)
* 5-V-kompatible Karten haben eine Kerbe rechts
* Universalkarten haben beide Kerben

* Slots nach PCI 2.x haben einen Steg rechts (die dem Slotblech abgewandte Seite). Die PCI 2.3-Spezifikation unterstützt zwar keine 5-V-Karten mehr, diese passen aber dennoch physisch in den Slot. Einige Mainboards unterstützen allerdings trotzdem noch 5-V-Karten in PCI-2.3-Slots. Das geht aber nur mit 33&nbsp;MHz PCI Takt. →Mainboardspezifikation konsultieren.
* Slots nach PCI 3.0 haben einen Steg links (Richtung Slotblech), so dass nur noch 3,3-V- und Universalkarten mit der entsprechenden Kerbe eingesteckt werden können.

== Andere PCI-Varianten ==
* [[PCI eXtensions for Instrumentation]] (PXI) ist ein auf PCI-Technik basierender Bus, welcher für die besonderen Anforderungen in der Mess- und Automatisierungstechnik optimiert wurde.
* [[Extended PCI]] (PCI-X)
* [[PCI Express]] (zuerst 3GIO genannt [Eingabe/Ausgabe der dritten Generation], Abkürzung ''PCIe'' oder ''PCI-E'') ist im Gegensatz zum PCI-Bus auf der elektrischen Ebene eine serielle Punkt-zu-Punkt-Verbindung, die aber PCI-Signalisierung und -Programmiertechniken verwendet und daher von Betriebssystem und Software wie PCI behandelt werden kann. Seit 2004 ersetzt PCI Express schrittweise sowohl PCI als auch [[Accelerated Graphics Port|AGP]]. Sie ist nicht kompatibel zu PCI oder AGP.

== Powermanagement mit PCI ==
Die Energiesparfunktionen für den PCI-Bus sind Teil einer optional zu implementierenden Spezifikation, die zeitlich zwischen den PCI-Versionen 2.1 und 2.2 angesiedelt ist. Jedes PM-fähige Gerät hat ein zusätzliches 8 Byte langes Feld im Configuration Space, über das es mitteilen kann, welche Energiespar-Modi es unterstützt und entsprechend gesteuert werden kann. Jedes PCI-Gerät kann sich in einem von vier möglichen Operationsmodi befinden (D0-D3). Je höher die Nummer, desto weniger Energie verbraucht das Gerät. Auch wenn ein Gerät nichts von PCI-Powermanagement weiß, unterstützt es die Modi D0 und D3, da diese äquivalent zu ''an'' und ''aus'' sind. Ob und wie viel Energie in den dazwischen liegenden Modi gespart werden kann, liegt im Ermessen des Hardware-Herstellers. Ein Gerät kann aus einem bestimmten Modus in alle „darunter“ liegenden Modi wechseln sowie aus jedem Modus in den Zustand D0.

Obwohl man Geräte durchaus manuell, während des laufenden Betriebes, in einen anderen Energiesparmodus bringen kann, wird man in den meisten Fällen mit Hilfe von [[Advanced Power Management|APM]] oder [[Advanced Configuration and Power Interface|ACPI]] einen globalen Energiesparmodus für den Computer setzen, der vom Powermanagement des Betriebssystems gesteuert wird. In den Modi D1 und D2 besteht für ein entsprechend ausgerüstetes PCI-Gerät die Möglichkeit, zu einem beliebigen Zeitpunkt ein sogenanntes Power Management Event Signal (PME) auf den Bus zu legen, das dann an das Powermanagement des Betriebssystems weitergeleitet wird und dazu verwendet werden kann, das System auf Anforderung wieder global „aufzuwecken“, etwa wenn eine Netzwerkkarte einlaufende Daten erkennt, die behandelt werden müssen.

== Begriffe ==
* ''Fast Back-to-Back:'' Wenn alle Geräte diesen Modus unterstützen, kann die Idle-Phase zwischen zwei PCI-Zyklen entfallen. Das erhöht den Datendurchsatz auf dem Bus.
* ''Special Cycle:'' Über „Special Cycle“ können Rundrufnachrichten (Broadcast messages) an alle angeschlossenen Geräte gesendet werden.
* ''Address Space:'' einer von drei Adressbereichen – Memory, I/O oder Configuration Space
* ''Configuration Space:'' Der „Configuration Space“ ist ein Speicherbereich (256 bzw. 4096 Bytes für PCI-X und PCIe) jedes PCI-Geräts, der zur Identifizierung und Konfiguration des Geräts dient. Der Configuration Space besteht aus einem standardisierten Kopf (Header) und zusätzlichen gerätespezifischen Daten wie beispielsweise Adressbereichen. Das BIOS bzw. der Treiber für ein PCI-Gerät kann anhand dieser Daten das Gerät passend konfigurieren.

== Interessengruppen ==
=== Special Interest Group ===
1992 wurde die ''Spezielle Interessengruppe'' „PCI-SIG“ (ursprüngliche Bezeichnung: „Peripheral Component Interconnect Special Interest Group“) gegründet. Die Aufgabe der PCI-SIG ist die Verwaltung und die Weiterentwicklung des PCI-Standards. Bei PCI-SIG können Firmen und Organisationen Mitglied werden. Im Jahr 2007 gab es mehr als 800 Mitglieder.

=== PCI Industrial Computer Manufacturers Group ===
Die 1994 gegründete PCI Industrial Computer Manufacturers Group ([[PICMG]]) ist ein Konsortium aus über 450&nbsp;Firmen, die den PCI-Standard für die Nutzung im industriellen Bereich, in der Medizin, dem Militär und der Telekommunikation erweitern wollen. Daraus entstanden Spezifikationen wie [[CompactPCI]] oder [[AdvancedTCA]].

== Literatur ==
* Don Anderson, Tom Shanley: ''PCI System Architecture.'' 4th Edition. Addison-Wesley, Reading MA u.&nbsp;a. 1999, ISBN 0-201-30974-2.

== Weblinks ==
{{Commonscat|PCI}}
* [http://www.math.uni.wroc.pl/~p-wyk4/so/pci23.pdf PCI Local Bus Specification – Revision 2.3 – March 29, 2002] (PDF; 4,3&nbsp;MB) Spezifikationen (englisch)
* [http://www.pcisig.com/ PCI Special Interest Group (PCI-SIG)] (englisch)
* {{webarchiv|url=http://www.techfest.com/hardware/bus/pci.htm |wayback=20150219073659|text=PCI Local Bus Technical Summary}} (englisch)
* [http://www.pcidatabase.com/ PCI Vendor and Device Lists] – Datenbank der PCI Ids (englisch)
* [http://www.swyx.com/de/support/ssdb.html?kbid=kb2471 Überblick über die verschiedenen PCI Karten- und Slot-Typen und deren Kombinationsmöglichkeiten]
* [http://pinouts.ru/Slots/PCI_pinout.shtml PCI bus pinout] (englisch)
* [http://www.digi.com/pdf/prd_msc_pcitech.pdf PCI Technology Overview – February 2003] (PDF; 293&nbsp;kB; englisch)
* [http://pciids.sourceforge.net/ PCI-IDs] Sourceforge.net (englisch)

== Einzelnachweise ==
<references />

[[Kategorie:Peripheriebus (intern)]]